Outsource asic vlsi fpga verilog vhdl jobs

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    5,201 outsource asic vlsi fpga verilog vhdl trabalhos encontrados, preços em USD

    Implementar um jogo em verilog ou vhdl em vga

    $140 (Avg Bid)
    $140 Média
    6 ofertas

    Jogo VGA em Verilog para FPGA

    $154 (Avg Bid)
    $154 Média
    3 ofertas
    VHDL/verilog Encerrado left

    Segue trabalho em anexo

    $147 (Avg Bid)
    $147 Média
    10 ofertas
    Verilog e FPGA Encerrado left

    Implementar um JOGO mais simples possível com apenas os leds na linguagem verilog ou vhdl... Pode ser o jogo de decorar as cores dos leds que piscam, ou campo minado com leds, qualquer jogo simples (sem gráficos VGA.. projeto super simples na linguagem verilog).

    $26 (Avg Bid)
    $26 Média
    3 ofertas

    Preciso de um projeto em Verilog que gerencie o consumo de água de uma residencia.

    $434 (Avg Bid)
    $434 Média
    2 ofertas

    Olá Pedro, Você trabalho com FPGA (Zedboard) Xilinx? Preciso de um programa capaz de exibir a camera do Kinect em uma placa Zedboard.

    $100 (Avg Bid)
    $100 Média
    1 ofertas

    evolutive development and maintenance of PHP/Javascript/Postgre Web application

    PHP
    $1872 (Avg Bid)
    $1872 Média
    16 ofertas
    Veriog Tomasulo Encerrado left

    Neste projeto você irá utilizar Verilog para implementar o algoritmo Tomasulo de despacho simples como descrito no livro texto (Seções 3.4 e 3.5). Descrição No algoritmo Tomasulo a execução das instruções é dividida em 3 estágios: despacho, execução e write back. Esses três está...

    $472 (Avg Bid)
    $472 Média
    3 ofertas

    Preciso fazer um hardware com FPGA Altera ou Spartan da Xilinix programado em VHDL. Ele precisa receber e enviar pacotes UDP de um computador através da porta Ethernet. Eu já tenho o software que faz o envio dos pacotes UDP, hoje eu uso um hardware com FPGA Spartan III, pronto comprado da China. O hardware e o software que roda no computador são

    $2065 (Avg Bid)
    $2065 Média
    2 ofertas

    ...para formar uma palavra de 32 bits. Os sinais de controle m1, m2, m3, wPC, wMem, wRI devem ser associados às chaves de entrada. Um arquivo comprimido com todos os módulos VHDL do MIPS multiciclo é disponibilizado no Moodle. O código MIPS a ser carregado na memória está contido no arquivo mem.mif. Para exibição dos dados nos ...

    $96 (Avg Bid)
    $96 Média
    3 ofertas

    Bom dia, Existe possibilidade de parceria entre a nossa empresa e a vossa para realizar por outsourcing os trabalhos de SEO dos nossos clientes? tiago@[login to view URL] [login to view URL]

    $24 / hr (Avg Bid)
    $24 / hr Média
    1 ofertas

    Preciso de código em VHDL e respectivos ficheiros de testbench para um relógio digital. No LCD deve de aparecer: Linha 1: HH:MM:SS Linha 2: Relógio PNL Horas (HH) de 00 a 23 Com possibilidade de acerto Placa com frequência de relógio de 50Mhz Placa onde irá funcionar Xilinx/ Diligent Sparten-3E Preciso do có...

    $309 (Avg Bid)
    $309 Média
    1 ofertas
    fpga develop 6 dias left

    program with fpga to control TCP data and flow.

    $1234 (Avg Bid)
    $1234 Média
    7 ofertas
    PRESENT-80 6 dias left

    Hi there! I'm based in Ahmedabad, India. This project is related to lightweight cipher, cryptography. I have attached a pdf containing information relevant to this project w...design so that I can perform power analysis on it. Need the code properly working in two days. I looking for a Clock based implementation on existing design Language used : VHDL

    $61 (Avg Bid)
    $61 Média
    5 ofertas

    Hi there! I'm based in Hyderabad, India. This project is related to cryptography. I have attached a pdf containing information relevant to this project which can be found...clock based design so that I can perform power analysis on it. Need the code properly working in two days. Note: Clock based implementation on existing design Language used : VHDL

    $30 (Avg Bid)
    $30 Média
    2 ofertas
    programing fpga 5 dias left

    programing fpga for mining ethereum

    $8556 (Avg Bid)
    $8556 Média
    17 ofertas

    In this project I need to optimize the code for Groestl miner VCU 1525 to smaller FPGA (Artix-7 XC7A200T). Groestl will be slightly modified and this modification will need to be reflected here. The optimal target speed is 50-70 MHs. (code [login to view URL]) You'll need to adjust the mining program for control and run on

    $248 (Avg Bid)
    $248 Média
    6 ofertas

    ...间开采出来的区块数量而进行调整,将出块时间维持在10分钟左右,以保证系统的平衡。而矿工想要争取到区块链的记账权,获得相应奖励,就需要不断提高自己的算力,也就是计算出正确哈希值的速度,这将消耗大量电力。 最初,每个用户都可以通过运行原始的比特币客户端,来使用CPU进行挖矿。然而,随着挖矿算力不断提升,CPU挖矿的时代已经成为过去式,随之而来的是ASIC矿机挖矿和大规模集群挖矿的时代。 当然,除了POW挖矿之外,以POS为共识机制的数字资产也同样需要挖矿。只是在 PoS机制中,增加货币供应的过程分为两个部分,交易所开发Q周顾问3II2325834一部分是根据用户持有货币的数量和时间派发利息;另一部分才是类似于POW的挖矿过程,它基于交易输入和其他一些固定数据计算哈希值,挖矿难度与交易输入的“币龄”成反比。

    $51111 (Avg Bid)
    $51111 Média
    5 ofertas

    Requirements: - Proficient in Verilog/VDHL and C/C++ - Experienced with Xilinx Vivado - Experienced in debugging on ILA/JTAG Preferred Qualifications: - Familiar with AXI interface - Familiar with wireless communication system VLNComm has several current working FPGA projects and one incomplete FPGA project in development on the topic of visible

    $4513 (Avg Bid)
    $4513 Média
    22 ofertas

    We want to outsource our digital marketing as well as website in order to score highest rank in search engines and get more sales through online promotions.

    $23 / hr (Avg Bid)
    $23 / hr Média
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