Encerrado

Parte Operativa mips multiciclo

O MIPS Multiciclo utiliza uma única memória para armazenar programa e dados. A

memória é endereçada pelo PC ou pelo registrador na saída da ULA, através de um

multiplexador, sendo as instruções lidas da memória transferidas para o Resitrador de

Instruções – RI e os dados lidos transferidos para o Registrador de Dados da Memória –

RDM.

Neste trabalho deve-se instanciar o conjunto de módulos que compõe a parte da unidade

operativa encarregada do acesso à memória. É composta pelos seguintes componentes:

• PC (32 bits)

• REM – registrador para endereçar os dados da memória (32 bits)

• multiplexador de entrada de endereço (32 bits)

• memória do MIPS

• RDM e RI (32 bits cada)

Para entrada e saída de dados deve-se utilizar:

• 8 chaves para entrada de dados

• botão para acionar o relógio

• mostrador de 7 segmentos para exibir conteúdo de RI e RDM

O PC deve ter 32 bits. A memória tem apenas 256 palavras de 32 bits, de forma que

apenas 8 bits do PC devem ser utilizados no seu endereçamento. Tanto os endereços de

dados quanto os dados para escrita na memória vem do teclado, onde os 8 bits

provenientes das chaves devem ser concatenados com 24 ‘0’s para formar uma palavra de

32 bits.

Os sinais de controle m1, m2, m3, wPC, wMem, wRI devem ser associados às chaves de entrada.

Um arquivo comprimido com todos os módulos VHDL do MIPS multiciclo é

disponibilizado no Moodle. O código MIPS a ser carregado na memória está contido no

arquivo mem.mif.

Para exibição dos dados nos mostradores, utilizar os acionadores de display de 7

segmentos feito na primeira aula de laboratório.

Simular o circuito no ModelSim e prototipá-lo na placa DE2-70.

Escrever um testbench VHDL para simulação no ModelSim realizando as seguintes

tarefas:

• ler o conteúdo das instruções armazenadas na memória

• escrever na memória uma sequência de dados e depois realizar a sua leitura

• na simulação ModelSim não são usadas chaves nem os displays de 7 segmentos

Realizar a mesma atividade nas placas DE2-70.

Habilidades: Engenharia, Verilog / VHDL

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( 0 comentários ) Brazil

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loi09dt1

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